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使用基于Raspberry Pi的DDS信號(hào)發(fā)生器實(shí)現(xiàn)精確RF測(cè)試
在涉及射頻(RF)的硬件測(cè)試中，選擇可配置、已校準(zhǔn)的可靠信號(hào)源是其中最重要的方面之一。本文提供了基于Raspberry Pi的高度集成解決方案，其可用于合成RF信號(hào)發(fā)生器，輸出DC至5.5 GHz的單一頻率信號(hào)，輸出功率范圍為0 dBm至-40 dBm。所提出的系統(tǒng)基于直接數(shù)字頻率合成(DDS)架構(gòu)，并對(duì)其輸出功率與頻率特性進(jìn)行了校準(zhǔn)，可確保在整個(gè)工作頻率范圍中，輸出功率保持在所需功率水平的±0.5 dB以內(nèi)。
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基于FPGA的DDS信號(hào)發(fā)生器設(shè)計(jì)
摘要：利用FPGA芯片及D/A轉(zhuǎn)換器，采用直接數(shù)字頻率合成技術(shù)，設(shè)計(jì)并實(shí)現(xiàn)了一個(gè)頻率、幅值可調(diào)的信號(hào)發(fā)生器，同時(shí)闡述了該信號(hào)發(fā)生器的工作原理、電路結(jié)構(gòu)及設(shè)計(jì)思路。經(jīng)過電路調(diào)試，輸出波形達(dá)到技術(shù)要求，證明了該信
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基于FPGA和虛擬儀器的DDS信號(hào)發(fā)生器設(shè)計(jì)
摘要：將虛擬儀器技術(shù)同F(xiàn)PGA技術(shù)結(jié)合，設(shè)計(jì)了一個(gè)頻率可控的DDS任意波形信號(hào)發(fā)生器。在闡述直接數(shù)字頻率合成技術(shù)的工作原理、電路構(gòu)成的基礎(chǔ)上，分別介紹了上位機(jī)虛擬儀器監(jiān)控面板的功能和結(jié)構(gòu)，以及實(shí)現(xiàn)DDS功能的下
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基于SoPC的DDS信號(hào)發(fā)生器設(shè)計(jì)
摘要：直接數(shù)字頻率合成技術(shù)是一種新型的信號(hào)產(chǎn)生方法，是現(xiàn)代信號(hào)源的發(fā)展方向。該系統(tǒng)由FPGA控制模塊、鍵盤、LED顯示組成，結(jié)合DDS的結(jié)構(gòu)和原理，采用SOPC和DDS技術(shù)，設(shè)計(jì)出具有頻率設(shè)置功能的多波形信號(hào)發(fā)生器。以
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基于SoPC的DDS信號(hào)發(fā)生器設(shè)計(jì)
摘要：直接數(shù)字頻率合成技術(shù)是一種新型的信號(hào)產(chǎn)生方法，是現(xiàn)代信號(hào)源的發(fā)展方向。該系統(tǒng)由FPGA控制模塊、鍵盤、LED顯示組成，結(jié)合DDS的結(jié)構(gòu)和原理，采用SOPC和DDS技術(shù)，設(shè)計(jì)出具有頻率設(shè)置功能的多波形信號(hào)發(fā)生器。以
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基于SOPC的DDS信號(hào)發(fā)生器設(shè)計(jì)
摘 要：直接數(shù)字頻率合成技術(shù)是一種新型的信號(hào)產(chǎn)生方法，是現(xiàn)代信號(hào)源的發(fā)展方向。該系統(tǒng)由FPGA 控制模塊、鍵盤、LED 顯示組成，結(jié)合DDS 的結(jié)構(gòu)和原理，采用SOPC 和DDS 技術(shù)，設(shè)計(jì)出具有頻率設(shè)置功能的多波形信號(hào)發(fā)
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基于SOPC的DDS信號(hào)發(fā)生器設(shè)計(jì)
摘 要：直接數(shù)字頻率合成技術(shù)是一種新型的信號(hào)產(chǎn)生方法，是現(xiàn)代信號(hào)源的發(fā)展方向。該系統(tǒng)由FPGA 控制模塊、鍵盤、LED 顯示組成，結(jié)合DDS 的結(jié)構(gòu)和原理，采用SOPC 和DDS 技術(shù)，設(shè)計(jì)出具有頻率設(shè)置功能的多波形信號(hào)發(fā)
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基于SOPC的DDS信號(hào)發(fā)生器設(shè)計(jì)
基于SOPC的DDS信號(hào)發(fā)生器設(shè)計(jì)
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基于FPGA的DDS信號(hào)發(fā)生器設(shè)計(jì)
介紹基于DDS的信號(hào)發(fā)生器工作原理和設(shè)計(jì)過程，并對(duì)關(guān)鍵模塊及外圍電路進(jìn)行了仿真和誤差分析。經(jīng)功能驗(yàn)證和分析測(cè)試，達(dá)到了預(yù)定的各項(xiàng)技術(shù)指標(biāo)。旨在建立一種以FPGA為核心，功能可裁剪、波形任意調(diào)整的高性能信號(hào)發(fā)生器設(shè)計(jì)方法。采用該設(shè)計(jì)法將有效地降低開發(fā)成本，提高設(shè)計(jì)效率，并具有一定的工程指導(dǎo)意義和實(shí)用價(jià)值。
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基于FPGA的DDS信號(hào)發(fā)生器設(shè)計(jì)
介紹基于DDS的信號(hào)發(fā)生器工作原理和設(shè)計(jì)過程，并對(duì)關(guān)鍵模塊及外圍電路進(jìn)行了仿真和誤差分析。經(jīng)功能驗(yàn)證和分析測(cè)試，達(dá)到了預(yù)定的各項(xiàng)技術(shù)指標(biāo)。旨在建立一種以FPGA為核心，功能可裁剪、波形任意調(diào)整的高性能信號(hào)發(fā)生器設(shè)計(jì)方法。采用該設(shè)計(jì)法將有效地降低開發(fā)成本，提高設(shè)計(jì)效率，并具有一定的工程指導(dǎo)意義和實(shí)用價(jià)值。
