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基于zedboard的串口使用實(shí)例，vivado vitis 2021

時(shí)間：2021-11-09 13:59:21
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[導(dǎo)讀]VivadoML最新版2021下載方法：《安裝Vivado2021.1ML版，編譯時(shí)間真的會(huì)減少嗎？》今天我們通過(guò)zedboard串口使用的實(shí)例來(lái)簡(jiǎn)單介紹vivado和vitis的使用步驟。1，首先打開軟件，新建一個(gè)空白工程：createproject2，選擇工程路徑和FPGA型...

Vivado ML最新版2021下載方法：《安裝Vivado 2021.1 ML版，編譯時(shí)間真的會(huì)減少嗎？》



今天我們通過(guò)zedboard串口使用的實(shí)例來(lái)簡(jiǎn)單介紹vivado和vitis的使用步驟。



1，首先打開軟件，新建一個(gè)空白工程：create project





2，選擇工程路徑和FPGA型號(hào)：zynq-7000系列的xc7z020




3，新建block design，點(diǎn)擊“ ”添加ZYNQ7處理器系統(tǒng)，也就是所謂的PS部分。






4，添加后雙擊進(jìn)行設(shè)置，分別設(shè)置串口、時(shí)鐘和DDR。







5，點(diǎn)擊run block automation，連接時(shí)鐘，點(diǎn)擊validation





6，右擊sources下BD_PS，先generate output products，完成后create HDL Wrapper，完成后點(diǎn)擊左側(cè)欄最下面的generate bitstream，產(chǎn)生bit文件。至此，硬件電路就搭建完成了。





7，bit生成后，在左側(cè)頂端file下導(dǎo)出Hardware，記得選 include bitstream，然后選擇 .xsa文件的存放位置和名稱。





8，launch vitis IDE，選擇workspace位置，新建platform，選擇之前導(dǎo)出的 .xsa文件。






9，新建 application project，選擇hello world工程





10，右鍵uart_use，debug as -> debug config，雙擊GDB進(jìn)行配置




11，打開串口助手（自行查看串口號(hào)），打開zedboard開發(fā)板電源，修改程序后編譯，run，從串口助手上看到結(jié)果：





12，需要本文工程源文件的請(qǐng)給“軟硬件技術(shù)開發(fā)”微信公眾號(hào)發(fā)送關(guān)鍵詞“hello world”下載，是vivado vitis2021版本的。






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