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從此踏實(shí)CPLD開(kāi)發(fā)這條“不歸路”——睿智 EPM570開(kāi)發(fā)板評(píng)測(cè)

CPLD   EPM570   可編程邏輯   Altera   
  • 作者:中國(guó)菜鳥(niǎo)領(lǐng)導(dǎo)者
  • 來(lái)源:21ic
  • [導(dǎo)讀]
  • 在硬件原理設(shè)計(jì)和布線的時(shí)候,CPLD不用考慮引腳的順序,可從布方便的角度安排需要的信號(hào)位置,使得布線難度大幅度降低,直接帶來(lái)布線優(yōu)化的好處。如此方便的設(shè)計(jì),各位搞單片機(jī)嵌入式的工程師友,有沒(méi)有想要學(xué)習(xí)的沖動(dòng)?!

導(dǎo)讀

CPLD是復(fù)雜可編程邏輯器件的縮寫(xiě),能應(yīng)用cpld技術(shù)是一個(gè)十分強(qiáng)大的能力。它的應(yīng)用可在根本上解決許多數(shù)字電路設(shè)計(jì)的問(wèn)題,能大幅度改變?cè)O(shè)計(jì)思想,大幅度提高工作效率;對(duì)于嵌入式開(kāi)發(fā)者來(lái)說(shuō),當(dāng)需要很多外設(shè)的時(shí)候,我們往往需要加入很多數(shù)字芯片,造成PCB體積大,走線難,這些問(wèn)題應(yīng)用一個(gè)CPLD芯片就可以實(shí)現(xiàn):在硬件原理設(shè)計(jì)和布線的時(shí)候,CPLD不用考慮引腳的順序,可從布方便的角度安排需要的信號(hào)位置,使得布線難度大幅度降低,直接帶來(lái)布線優(yōu)化的好處。如此方便的設(shè)計(jì),各位搞單片機(jī)嵌入式的工程師友,有沒(méi)有想要學(xué)習(xí)的沖動(dòng)?!

一、前言

20世紀(jì)80年代中期,CPLD初步誕生,經(jīng)過(guò)幾十年的發(fā)展,許多公司都開(kāi)發(fā)出了CPLD可編程邏輯器件,Altera、Lattice、Xilinx是世界三大權(quán)威公司,產(chǎn)品目前此應(yīng)用已深入網(wǎng)絡(luò)、儀器儀表、汽車(chē)電子、數(shù)控機(jī)床、航天測(cè)控設(shè)備等多個(gè)方面,幾乎占領(lǐng)了整個(gè)CPLD/FPGA的市場(chǎng)。

二、開(kāi)箱

內(nèi)外兩層紙箱,可以避免運(yùn)輸途中對(duì)板子的損壞。內(nèi)盒包裝上有睿智研發(fā)的標(biāo)簽,右下角有兩個(gè)二維碼,左邊的是技術(shù)論壇,價(jià)位低,還提供技術(shù)支持非常不錯(cuò),右邊的二維碼是淘寶直營(yíng)店,宣傳做的不錯(cuò)堯

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箱子里分別有CPLD主控板、下載器、供電電源三大部分,本來(lái)以為有光盤(pán)的,后來(lái)問(wèn)了下說(shuō)沒(méi)有光盤(pán),提供網(wǎng)盤(pán)下載,都是一樣的資料,也無(wú)所謂了

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PCB主板全局以黑色調(diào)為主,給人以沉穩(wěn)大氣的感覺(jué),器件布局左右對(duì)稱,PCB板背面無(wú)任何原件,板載資源還真不少,該有的按鍵、數(shù)碼管、蜂鳴器、串口等都有,除了主芯片外,目測(cè)與單片機(jī)開(kāi)發(fā)板的常用外設(shè)沒(méi)區(qū)別

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板子背面

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側(cè)視圖

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三、板載硬件資源簡(jiǎn)介

主芯片采用 Altera 公司高性價(jià)比:MAXII 系列EPM570T100C5N,封裝為100-TQFP

存儲(chǔ)器類型為FLASH型,供電電壓為3.3V,顧名思義邏輯塊元件數(shù)為570個(gè),工作溫度為0-85度,支持高達(dá)300 MHz 的內(nèi)部時(shí)鐘頻率,芯片具體參數(shù)大家可以去百度搜索,資料很多。

下面主要介紹下開(kāi)發(fā)板的板載外設(shè)資源

外設(shè)框圖與實(shí)物對(duì)比:

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3.1電源電路

外部5V供電后,電源指示燈亮起,5V經(jīng)過(guò)1173V3 LDO穩(wěn)壓芯片給EPM570提供3.3V電壓

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3.2時(shí)鐘與復(fù)位電路

板載50MHZ有源晶振,與無(wú)源晶振相比更加穩(wěn)定,預(yù)留接口,用戶可以自由擴(kuò)展自己

晶振規(guī)格,非常方面使用

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3.3、JTAG下載接口電路

下載接口為通用的JTAG接口,此處為了提高穩(wěn)定性,TDI/TMS分別增加了

上拉電阻

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