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單穩(wěn)態(tài)電路圖

時(shí)間：2014-07-09 13:06:32
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[導(dǎo)讀] 　　在穩(wěn)定狀態(tài)左晶體管導(dǎo)通，而右晶體管截止。輸入負(fù)脈沖使左晶體管截止，右晶體管導(dǎo)通。隔一定時(shí)間反又恢復(fù)到原來(lái)狀態(tài)。這段時(shí)間即準(zhǔn)穩(wěn)態(tài)時(shí)間決定于電容C和充放電電阻R的

 　　在穩(wěn)定狀態(tài)左晶體管導(dǎo)通，而右晶體管截止。輸入負(fù)脈沖使左晶體管截止，右晶體管導(dǎo)通。隔一定時(shí)間反又恢復(fù)到原來(lái)狀態(tài)。這段時(shí)間即準(zhǔn)穩(wěn)態(tài)時(shí)間決定于電容C和充放電電阻R的大小，為tm≈0.7RC.例如C=250uF和放電電阻R=18k歐，則tm=3.15s.

　　

單穩(wěn)態(tài)電路圖

作者：jsp

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