中芯國(guó)際與Cadence共推65納米低功耗解決方案

電子設(shè)計(jì)企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司今天宣布推出一款全面的低功耗設(shè)計(jì)流程，面向基于中芯國(guó)際65納米工藝的設(shè)計(jì)工程師。該流程以Cadence低功耗解決方案為基礎(chǔ)，通過使用一個(gè)單一、全面的設(shè)計(jì)平臺(tái)，可以更加快速地實(shí)現(xiàn)尖端、低功耗半導(dǎo)體產(chǎn)品的設(shè)計(jì)。

“目前，功耗已成為一個(gè)關(guān)鍵的設(shè)計(jì)制約因素，從技術(shù)和成本的角度來說，它同時(shí)序和面積一樣重要”，SMIC設(shè)計(jì)服務(wù)中心副總裁劉明剛表示，“SMIC-Cadence Reference Flow 4.0具有先進(jìn)的自動(dòng)化低功耗設(shè)計(jì)功能，能夠滿足低功耗設(shè)計(jì)創(chuàng)新的需要。”

通過低功耗芯片的設(shè)計(jì)實(shí)現(xiàn)，完成了對(duì)該設(shè)計(jì)流程的確認(rèn)。上述芯片利用了 SMIC 的內(nèi)部設(shè)計(jì)65納米庫(kù)，包括有效的電流源模型(ECSM)標(biāo)準(zhǔn)單元、功耗管理單元、PLL、SRAM 和 I/O 庫(kù)。該設(shè)計(jì)中所采用的低功耗技術(shù)包括功率門控和多電源/多電壓(MSMV)技術(shù)，可以降低漏電和動(dòng)態(tài)功耗消耗。

“能率對(duì)許多新型半導(dǎo)體產(chǎn)品來說都是一個(gè)關(guān)鍵的要求，然而設(shè)計(jì)者有時(shí)卻認(rèn)為關(guān)注于功耗只是最近才剛剛興起，因而伴隨著很多風(fēng)險(xiǎn)”，Cadence公司產(chǎn)品營(yíng)銷副總裁 Steve Carlson 表示，“Cadence 低功耗解決方案提供了全面的、經(jīng)過硅驗(yàn)證的從前端到后端的流程，面向基于SMIC的65納米工藝技術(shù)的設(shè)計(jì)者，它包括對(duì)功能和結(jié)構(gòu)的驗(yàn)證，同時(shí)提高了生產(chǎn)率。該解決方案快速、易用并經(jīng)過了實(shí)踐檢驗(yàn)。”