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[導讀]硅產品知識產權 (SIP) 平臺解決方案和數字信號處理器 (DSP) 內核授權廠商CEVA公司現已推出業(yè)界首個集成式優(yōu)化工具鏈,能夠對可授權DSP 內核實現完全基于C語言的端至端開發(fā)流程。該應用優(yōu)化器 (Application Optimizer

硅產品知識產權 (SIP) 平臺解決方案和數字信號處理器 (DSP) 內核授權廠商CEVA公司現已推出業(yè)界首個集成式優(yōu)化工具鏈,能夠對可授權DSP 內核實現完全基于C語言的端至端開發(fā)流程。該應用優(yōu)化器 (Application Optimizer) 包括于CEVA-ToolBox™  軟件開發(fā)環(huán)境套件內供貨,可讓應用開發(fā)人員完全以C語言級輕易開發(fā)CEVA DSP軟件,無需任何手寫的匯編語言,從而顯著提高 SoC 設計的總體性能并縮短其設計周期。


較其它可授權解決方案具有顯著的性能優(yōu)勢
 
 加入了應用優(yōu)化器后,CEVA DSP內核的開發(fā)環(huán)境獲得顯著增強,并可大大簡化軟件開發(fā)流程,提高目標應用程序的絕對性能。以使用標準窄帶自適應多速率壓縮 (AMR-NB) 的C語言語音編碼器為例,CEVA-X1622 DSP內核在編譯現成可用的代碼 (最差幀幅及流) 時,僅需19 MHz速率;而其它的可授權解決方案卻需要高45% 以上的速度,才能編譯同樣的現成代碼。

算法

OOB 
C 代碼*

經優(yōu)化的
C代碼*

經優(yōu)化的匯編代碼*

競爭對手的 OOB C 代碼 

AMR-NB

19 MHz

15 MHz

12.5 MHz

27.7 MHz

AMR-WB**

41.7 MHz

30 MHz

22 MHz

不適用

G.729AB

14 MHz

10.3 MHz

9.2 MHz

不適用

大幅縮短軟件開發(fā)時間

 隨著現代 SoC 架構設計的復雜性不斷增加,嵌入式軟件開發(fā)的重擔給 IC 供應商帶來了最艱巨的挑戰(zhàn),針對特定多元化系統(tǒng)架構編寫和優(yōu)化軟件的工作,成為了設計過程的最大瓶頸。利用應用優(yōu)化器工具鏈,結合CEVA-ToolBox™ 開發(fā)環(huán)境中的其它重要組件,能夠把軟件設計流程轉到純C語言,并可降低對設計工程師在專用架構方面的知識水平的要求。

 據市場研究機構Forward Concepts公司總裁兼創(chuàng)始人Will Strauss表示:“由于當今芯片設計的高度集成化,加上這些先進處理器的編程復雜性不斷提高,開發(fā)工具已成為DSP選擇的關鍵考慮因素。針對CEVA DSP內核而增加的全面端到端C 語言級軟件優(yōu)化工具鏈,可為設計DSP應用程序的客戶提供重要優(yōu)勢,避免冗長繁瑣且費時的匯編級優(yōu)化工作?!?/p>

應用優(yōu)化器的主要組件包括:

項目建立優(yōu)化器 (Project build optimizer):創(chuàng)建經優(yōu)化的建立配置,根據客戶應用與真實的系統(tǒng)條件,仿真和剖析多種應用場景
DSP 及通信軟件庫:C可呼叫 (C-callable) 匯編的優(yōu)化功能,大大提升DSP及通信應用的性能,并縮短開發(fā)時間
應用剖析器 (Application Profiler):一個周期精確的C語言級應用程序及存儲器子系統(tǒng)剖析器
基于評分的編譯:現成可用的C代碼與經優(yōu)化匯編的代碼,二者比值小于1:1.5
 應用優(yōu)化器的其它重要組件還有:鏈接后 (post linker) 優(yōu)化器、便于算法 (如MATLAB) 移植的調試器連接,以及測試環(huán)境自動控制。

 要了解有關應用優(yōu)化器和CEVA-ToolBox™ 開發(fā)環(huán)境的更多信息,請訪問網頁www.ceva-dsp.com/Toolbox

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