VHDL 的注釋以兩個(gè)連字符“--”開(kāi)始,到該行尾自動(dòng)結(jié)束,不支持成塊的注釋語(yǔ)句。 VHDL設(shè)計(jì)實(shí)體的組成:庫(kù)和程序包(Library,Package),實(shí)體(Entity),結(jié)構(gòu)體(Architecture),配置(Configuration).
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