電路
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基于FPGA平臺的抗DPA攻擊電路級防護(hù)技術(shù)研究
隨著現(xiàn)場可編程門陣列(FPGA)，芯片在安全領(lǐng)域上的廣泛應(yīng)用，有關(guān)FPGA密碼芯片的抗(DPA)研究也越來越受關(guān)注，但目前的研究成果大多針對智能卡的安全防護(hù)。在研究各種電路級安全防護(hù)技術(shù)的基礎(chǔ)上，采用硬件宏的方法將雙軌和預(yù)充電技術(shù)應(yīng)用于FPGA芯片的數(shù)據(jù)加密標(biāo)準(zhǔn)算法(DES)硬件結(jié)構(gòu)，通過DPA攻擊實(shí)驗(yàn)后發(fā)現(xiàn)，未加防護(hù)措施的DES加密系統(tǒng)難以抵御DPA攻擊，而加防護(hù)措施的加密系統(tǒng)具有抗DPA攻擊的能力。
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PCIe 3.0規(guī)格難產(chǎn)，2011年或開展兼容性測試
新版 PCI Express (PCIe)界面規(guī)格難產(chǎn)？最近 PCI SIG 公布了過渡性0.71版 PCI Express 3.0 規(guī)格，支援8 GigaTransfers；該標(biāo)準(zhǔn)組織打算在2011年初展開產(chǎn)品兼容性測試，時(shí)程已經(jīng)比原先預(yù)定的晚了一年。新版PCI Expres
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返回電流及其與通孔的關(guān)系
在多層板中，由于不止一個(gè)地平面，我們一定要仔細(xì)考慮返回地電流從哪里回流問題。圖5.2舉例說明了返回電流流向的基本原則：高帶返回信號電流沿著最小的電感路徑前進(jìn)。如果我們設(shè)想圖5.2中的地平面多于一個(gè)，對于哪個(gè)
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美科學(xué)家設(shè)計(jì)出簡便快速的納米電線制造方法
美科學(xué)家設(shè)計(jì)出簡便快速的納米電線制造方法，只需加熱即可將氧化石墨烯轉(zhuǎn)為導(dǎo)電物質(zhì)據(jù)美國物理學(xué)家組織網(wǎng)6月10日報(bào)道，美國一聯(lián)合研究小組稱，他們在利用石墨烯制造納米電路領(lǐng)域獲得了突破：設(shè)計(jì)出了簡便、快速的納米
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亞穩(wěn)態(tài)的錯(cuò)誤率分析
如圖3.30所示，采用ACTEL ACT-1門陣列實(shí)現(xiàn)的電路，當(dāng)輸入電壓變化時(shí)，其輸出產(chǎn)生脈沖的概率有多大？簡單應(yīng)用同步邏輯理論，它永遠(yuǎn)也不會發(fā)生。但現(xiàn)在我們會更好地理解這個(gè)問題了。首先檢查最壞情況下建立時(shí)間：TPD=9
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時(shí)鐘相位調(diào)整的簡單電路
圖3.23所示的電路，是一個(gè)16進(jìn)制的反相器，用于產(chǎn)生30~160NS的延遲。每一級的延遲時(shí)間是5~35NS，具體數(shù)值由可變電阻的值決定。每一級的延遲時(shí)間不應(yīng)該超過時(shí)鐘周期的12%，以保重穩(wěn)定工作。通過調(diào)整延遲級數(shù)（2或4）并
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單金屬片觸摸開關(guān)和電阻橋觸摸開關(guān)原理及電路
單金屬片觸摸開關(guān)原理及電路圖集 工作原理：圖1所示的電路只使用了一片觸摸金屬片，電路中采用了2只四二輸入端(內(nèi)部有四個(gè)完全相同的，具有兩個(gè)輸入端)施密特觸發(fā)器4093(如CD4093、 TC4093等等)。通常IC2-a的輸
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探頭是如何加重電路負(fù)載
示波器探頭的使用往往會改變被測電路的工作狀態(tài)。的確，我們都磁到過這樣的情形：當(dāng)用探頭測試電路時(shí)，電路工作正常，而一旦將探頭移開，電路的功能就會紊亂。這是一種常見的現(xiàn)象，也正是我們要討論的由示波器探頭引
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如何計(jì)算接地環(huán)路電感和算出阻尼雙極點(diǎn)的上升時(shí)間
在圖3.4中，接地環(huán)路的尺寸是1IN*3IN。這類探頭的接地導(dǎo)線典型的尺寸是美國線規(guī)（AWG）24，線徑為0.02IN。采用附錄C的電感計(jì)算公式，對于矩形回路，得到的電感應(yīng)該是：該電路的LC時(shí)間常數(shù)為：對于這類臨界阻尼雙極點(diǎn)
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交互式機(jī)頂盒的回傳電路設(shè)計(jì)研究
隨著全球數(shù)字電視節(jié)目開播日程表日漸逼近，機(jī)頂盒的熱門程度也隨之升高。目前，市面上大多數(shù)機(jī)頂盒均為單向接收功能，但只要搭配適當(dāng)?shù)碾p向電路，讓這些盒子具備回傳功能，便能成為交互式產(chǎn)品，可用來處理用戶發(fā)出的
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交互式機(jī)頂盒的回傳電路設(shè)計(jì)研究
交互式機(jī)頂盒的回傳電路設(shè)計(jì)研究
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四倍頻細(xì)分電路 (含波形圖)
1.光電編碼器原理光電編碼器，是一種通過光電轉(zhuǎn)換將輸出軸上的機(jī)械幾何位移量轉(zhuǎn)換成脈沖或數(shù)字量的傳感器。這是目前應(yīng)用最多的傳感器，光電編碼器是由光柵盤和光電檢測裝置組成。光柵盤是在一定直徑的圓板上等分地開
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地彈如何影響電路
圖2.17說明了地彈的情形。設(shè)想一個(gè)TTL D型八觸發(fā)器，由單一時(shí)鐘輸入，驅(qū)動一組32個(gè)存儲器的芯片組，以每條輸入線5PF計(jì)算，每條地址線的負(fù)載為160PF。假設(shè)進(jìn)入D觸發(fā)器輸入點(diǎn)的數(shù)據(jù)建立時(shí)間較長而保持時(shí)間較短，圖2.17
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自制25Wx2 EL34膽機(jī)電路
由于受到電子管器件本身的特性限制，業(yè)余制作膽機(jī)功放的輸出功率一般都不太大，尤其是采用單端輸出功放時(shí)，其輸出功率更小，通常僅數(shù)瓦，一般不超過10W。對于一臺10W的功率放大器，它往往只能提供l～2W的平均工作功率
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端接電路之間的互容
如果將“互容的測量”例中的電阻接地，將會發(fā)生什么呢？如果把“互容的測量”例中的每個(gè)電阻的一端接地，容性耦合噪聲電壓值大約除以6。直觀地來分析，如果用連接在兩個(gè)電阻正中間的寄生電容來表示這個(gè)互容，電阻RA的
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FM信號的解調(diào)電路--比例鑒頻器
斜率鑒頻器和相位鑒頻器的共同缺點(diǎn)是鑒頻輸出電壓不僅與輸入信號的瞬時(shí)頻率有關(guān)，而且還與輸入信號的振幅有關(guān)。因此，噪聲、各種干擾以及電路的頻率特性不均勻所引起的輸入信號的寄生調(diào)幅有關(guān)。因此，噪聲、各種干擾
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大信號檢波器電路--均值包絡(luò)檢波器
均值包絡(luò)檢波器圖5.5-16A為采用晶體三極管V和RLCL低通濾波器組成的均值包絡(luò)檢濾電路。由圖5.5-16B可以看出：放大器V選用乙類工作狀態(tài)。當(dāng)放大器加入高頻調(diào)幅波U1時(shí)，集電極電流便呈余弦脈沖序列波形，集電極脈沖電流
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大信號檢波器電路--并聯(lián)型二極管包絡(luò)檢波器
并聯(lián)型二極管包絡(luò)檢波器這種檢波器的原理電路見圖5.5-15A。圖中CL是負(fù)載電容，RL是負(fù)載電阻，RL與二極管VD并聯(lián)，為VD電流中的平均分量提供通路。鑒于RL與VD并接，故將這種電路稱為并聯(lián)型電路。并聯(lián)型電路具有與串聯(lián)型
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大信號檢波器電路--串聯(lián)型二極管峰值包絡(luò)檢波器
大信號（0.5V以上）檢波器，也稱包絡(luò)檢波器。1、串聯(lián)型二極管峰值包絡(luò)檢波器該種檢波器的原理電路如圖5.5-10A所示。在電路中，信號源U1、二極管VD和檢波負(fù)載RLCL是串聯(lián)相接的，故稱之為串聯(lián)型二極管峰值包絡(luò)檢波器。
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小信號平方律檢波器電路
小信號平方律檢波器電路小信號（一般輸入電壓在0.2V以下）檢波是利用二極管伏安特性曲線的彎曲部分。其基本電路如圖5.5-9所示。電源-VCC通過R對二極管VD加入正偏壓，使工作點(diǎn)Q置于特性曲線的彎曲部分。若忽略輸出電壓
火焰舞者
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劍圣灬哥
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天命風(fēng)流
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