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EDA典型單元電路的可逆計(jì)數(shù)器
所謂可逆計(jì)數(shù)器，就是根據(jù)計(jì)數(shù)控制信號(hào)的不同，在時(shí)鐘脈沖作用下，計(jì)數(shù)器可以進(jìn)行加1或者減1操作的一種計(jì)數(shù)器?？赡嬗?jì)數(shù)器有一個(gè)特殊的控制端，這就是DR端。當(dāng)DIR='0'時(shí)，計(jì)數(shù)器進(jìn)行加1操作，當(dāng)DIR='1'時(shí)，計(jì)數(shù)器就進(jìn)
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增強(qiáng)定時(shí)計(jì)數(shù)器和PWM輸出功能
1.1 引言 隨著計(jì)算機(jī)技術(shù)和電力電子技術(shù)的發(fā)展，變頻驅(qū)動(dòng)技術(shù)憑借其優(yōu)異的性能，在當(dāng)今交流調(diào)速領(lǐng)域的應(yīng)用越來(lái)越廣。 變頻驅(qū)動(dòng)主要使用的驅(qū)動(dòng)波形主要有SPWM和SVPWM兩種。SPWM原理簡(jiǎn)單、實(shí)現(xiàn)容易，
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基于定時(shí)器／計(jì)數(shù)器的實(shí)時(shí)時(shí)鐘的設(shè)計(jì)
1．實(shí)現(xiàn)實(shí)時(shí)時(shí)鐘的基本思想 時(shí)鐘的最小計(jì)時(shí)單位是秒，如何獲得1s的定時(shí)時(shí)間呢？使用定時(shí)器方式1，最大的定時(shí)時(shí)間也只能達(dá)到131 ms?？蓪⒍〞r(shí)器的定時(shí)時(shí)間定為100 ms，采用中斷方式進(jìn)行溢出次
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定時(shí)器/計(jì)數(shù)器方式3的編程和應(yīng)用
方式3下的T0和Tl大不相同。T0工作在方式3時(shí)，TL0和TH0被分成兩個(gè)獨(dú)立的8位定時(shí)器／計(jì)數(shù)器。其中，TL0可作為8位的定時(shí)器／計(jì)數(shù)器，而TH0只能作為8位的定時(shí)器。此時(shí)T1只能工作在方式0、1或2?！ ?/p>
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定時(shí)器/計(jì)數(shù)器方式2的編程和應(yīng)用
方式2是一個(gè)可以自動(dòng)重新裝載初值的8位計(jì)數(shù)器／定時(shí)器。這種工作方式可以省去用戶程序中重新裝入初值的指令?！ ‘?dāng)AT89S51的某個(gè)定時(shí)器／計(jì)數(shù)器不使用時(shí)，可為AT89S51擴(kuò)展一個(gè)負(fù)跳沿觸發(fā)的外部
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AT89S51定時(shí)器／計(jì)數(shù)器的結(jié)構(gòu)
AT89S51單片機(jī)的定時(shí)器／計(jì)數(shù)器結(jié)構(gòu)如下圖所示，定時(shí)器／計(jì)數(shù)器T0由特殊功能寄存器TH0、TL0構(gòu)成，定時(shí)器／計(jì)數(shù)器Tl由特殊功能寄存器TH1、TL1構(gòu)成?！ 蓚€(gè)定時(shí)器／計(jì)數(shù)器都具有定時(shí)器和計(jì)數(shù)器
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單片機(jī)定時(shí)計(jì)數(shù)器、中斷和串行口的學(xué)習(xí)
本期主要知識(shí)點(diǎn)為單片機(jī)定時(shí)計(jì)數(shù)器、中斷和串行口的學(xué)習(xí)。單片機(jī)對(duì)于初學(xué)者來(lái)說(shuō)確 實(shí)很難理解，不少學(xué)過(guò)單片機(jī)的同學(xué)或電子愛(ài)好者，甚至在畢業(yè)時(shí)仍舊是一無(wú)所獲?；诖耍娮影l(fā)燒友網(wǎng)將整合《單片機(jī)
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單片機(jī)中斷功能在干簧管計(jì)數(shù)器設(shè)計(jì)中的應(yīng)用
在本文的介紹中，要設(shè)計(jì)一個(gè)干簧管計(jì)數(shù)器，并用數(shù)碼管來(lái)顯示。本案例例中，還要接觸單片機(jī)一個(gè)重要的功能“中斷”。 干簧管是干式舌簧管的簡(jiǎn)稱，是一種有觸點(diǎn)的無(wú)源電子開(kāi)關(guān)元件，具有結(jié)構(gòu)簡(jiǎn)單，體積
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基于定時(shí)器／計(jì)數(shù)器的實(shí)時(shí)時(shí)鐘的設(shè)計(jì)
1.實(shí)現(xiàn)實(shí)時(shí)時(shí)鐘的基本思想時(shí)鐘的最小計(jì)時(shí)單位是秒，如何獲得1s的定時(shí)時(shí)間呢?使用定時(shí)器方式1，最大的定時(shí)時(shí)間也只能達(dá)到131 ms?？蓪⒍〞r(shí)器的定時(shí)時(shí)間定為100 ms，采用中斷
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手持式塵埃粒子計(jì)數(shù)器的使用注意事項(xiàng)
手持式塵埃粒子計(jì)數(shù)器是用于測(cè)量潔凈環(huán)境中單位體積內(nèi)塵埃粒子數(shù)和粒徑分布的儀器。手持式塵埃粒子計(jì)數(shù)器可廣泛應(yīng)用于為各省市藥檢所、血液中心、防疫站、疾控中心、質(zhì)量監(jiān)
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51單片機(jī)中的定時(shí)器和計(jì)數(shù)器
計(jì)數(shù)器的加1信號(hào)由振蕩器的12分頻信號(hào)產(chǎn)生，即每過(guò)一個(gè)機(jī)器周期，計(jì)數(shù)器加1，直至計(jì)滿溢出為止。顯然，定時(shí)器的定時(shí)時(shí)間與系統(tǒng)的振蕩頻率有關(guān)。
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如何應(yīng)對(duì)常見(jiàn)的在線燒錄異常情況
摘要：在線燒錄，顧名思義，直接在電路板上對(duì)芯片進(jìn)行燒錄，不依賴于燒錄座，不受燒錄座壽命影響，是一種低成本IC燒錄方式。每個(gè)產(chǎn)品的電路板各種各樣，存在很多不確定因素
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資深工程師FPGA設(shè)計(jì)經(jīng)驗(yàn)精華匯總
從大學(xué)時(shí)代第一次接觸FPGA至今已有10多年的時(shí)間。至今記得當(dāng)初第一次在EDA實(shí)驗(yàn)平臺(tái)上完成數(shù)字秒表，搶答器，密碼鎖等實(shí)驗(yàn)時(shí)，那個(gè)興奮勁。當(dāng)時(shí)由于沒(méi)有接觸到HDL硬件描述語(yǔ)
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使用定時(shí)器和計(jì)數(shù)器，以創(chuàng)建高效的基于微控制器的設(shè)計(jì)
動(dòng)翻譯，供參考使用定時(shí)器和計(jì)數(shù)器，以創(chuàng)建高效的基于微控制器的設(shè)計(jì)定時(shí)器和計(jì)數(shù)器也許在MCU設(shè)計(jì)中最普遍的外設(shè)。幾乎任何應(yīng)用程序可以使用一個(gè)定時(shí)器或計(jì)數(shù)器，以提高性能
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無(wú)聲定時(shí)提醒器電路
電路工作原理：電源開(kāi)關(guān)接通后，自動(dòng)復(fù)位電路工作，使各lC處于初始狀態(tài)?；鶞?zhǔn)信號(hào)發(fā)生電路8651B產(chǎn)生1/60 Hz的信垮，輸入計(jì)數(shù)器74HC192反向計(jì)數(shù)端。74HC192是可預(yù)置的4位正
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高速數(shù)據(jù)采集系統(tǒng)中精確時(shí)標(biāo)的CPLD實(shí)現(xiàn)方法
本文介紹一種利用復(fù)雜可編程邏輯器件給高速數(shù)據(jù)采集系統(tǒng)中的采集數(shù)據(jù)貼上精確時(shí)間標(biāo)簽的方法，并利用MAX PLUSⅡ開(kāi)發(fā)環(huán)境驗(yàn)證設(shè)計(jì)方案的正確性。此設(shè)計(jì)方案已經(jīng)成功地應(yīng)用到
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Linear 推出集成庫(kù)侖計(jì)數(shù)器的 50mA 同步降壓-升壓型 DC/DC 轉(zhuǎn)換器 LTC3335
凌力爾特公司 (Linear Technology Corporation) 推出毫微功率高效率同步降壓-升壓型轉(zhuǎn)換器 LTC3335，該器件內(nèi)置精準(zhǔn)的庫(kù)侖計(jì)數(shù)器。LTC3335 提供高達(dá) 50mA 的連續(xù)輸出電流。靜態(tài)電流僅為 680nA，而可編程峰值輸入電流為 5mA 至高達(dá) 250mA，非常適合多種低功率電池應(yīng)用。LTC3335 具 1.8V 至 5.5V 輸入范圍和 8 個(gè) 1.8V 至 5V 的用戶可選輸出，能夠以高于、低于或等于輸出的輸入電壓提供穩(wěn)定的輸出電源。此外，在長(zhǎng)壽命主電池應(yīng)用中，該器
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計(jì)數(shù)器中LED顯示控制電路圖
如圖所示，圖a中采用十進(jìn)制七段存儲(chǔ)-譯碼-驅(qū)動(dòng)單元74143，此單元對(duì)所有段都有恒流輸出。在電壓為5V時(shí)每段電流約為15～22mA。七段譯碼器的 BCD數(shù)據(jù)可以由腳17～20上取出。腳22用于進(jìn)位，即當(dāng)計(jì)數(shù)值到9后就為低電平，其余為高電平。利用這個(gè)信號(hào)可以控制上一位計(jì)數(shù)器。
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FPGA的圖像處理技術(shù)，你知道多少？
最近一段時(shí)間一直在研究基于FPGA的圖像處理，乘著這個(gè)機(jī)會(huì)和大家交流一下，自己也順便總結(jié)一下。主要是為了大家對(duì)用FPGA做圖像處理有個(gè)感性的認(rèn)識(shí)，如果真要研究的話就得更加深入學(xué)習(xí)了。本人水平有限，如有錯(cuò)誤，歡
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CPLD在信號(hào)濾波和抗干擾中的應(yīng)用
1 濾波和抗干擾概述單片機(jī)應(yīng)用系統(tǒng)的輸入信號(hào)常含有種種噪聲和干擾，它們來(lái)自被測(cè)信號(hào)源、傳感器、外界干擾源等。為了提高測(cè)量和控制精度，必須消除信號(hào)中的噪聲和干擾。噪聲有兩大類：一類為周期性的;另一類為不規(guī)則
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