RapidIO

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  • 利用串行RapidIO連接功能增強DSP協(xié)處理能力

    SRIO 正出現(xiàn)在大量新應用中，主要以有線和無線應用中的 DSP 為中心。在 Xilinx 器件中實現(xiàn) SRIO 架構的主要優(yōu)勢包括：整個 SRIO 端點解決方案的可用性;靈活性和可擴展性，便于使用同樣的硬件和軟件架構制成不同級別的產(chǎn)品;通過新 GTP 收發(fā)器和 65 nm 技術實現(xiàn)了低功耗;通過 CORE Generator 軟件 GUI 工具輕松進行配置;與業(yè)界領先的供應商間的硬件協(xié)同工作能力經(jīng)過了驗證，支持其器件上的 SRIO 連接; 通過使用 PCIe 和 TEMAC 等集成 I/O 模塊，實現(xiàn)了

  • 用RapidIO提高DSP陣列的性能

    “采用SERDES(串行/解串器)技術后只需少量引腳就能獲得很高的帶寬。由于硬件全部承擔了協(xié)議棧的處理，RapidIO減少了原來僅用于在系統(tǒng)中傳輸數(shù)據(jù)的寶貴DSP周期?！盨hippen說，“例如，多個飛思卡爾公司的StarCorebase

  • 迎合3.5G/4G基站Serial RapidIO架構趨勢的解決方案

    隨著用戶對于行動數(shù)據(jù)需求的增加，電信服務業(yè)者必須快速地布建 3.5G 和 4G 基站。這也使得下一代基站的架構需要高頻寬的背板，以容納多重的基頻卡(baseband card)數(shù)據(jù)傳輸?shù)男枨螅l板則需要數(shù)組的多核心數(shù)字信

  • 全球首屈一指的RapidIO IP解決方案

    RapidIO最早是由美國Mercury Computer systems公司（美國水星計算機系統(tǒng)公司www.mc.com）為它的計算密集型信號處理系統(tǒng)自行開發(fā)的總線技術。RapidIO是一種分組交換結構，最初開發(fā)它的目的是用來連接線路板上的

  • LATTICE攜手PRAESUM推出SERIAL RapidIO解決方案

    Lattice Semiconductor近日宣布，網(wǎng)絡通信應用的交換和橋接解決方案供應商Praesum優(yōu)化了其用于LatticeECP2M系列的Serial RapidIO接口端點方案，LatticeECP2M系列是集成有SERDES I/O的低成本90nm FPGA。 此外

  • 串行 RapidIO: 高性能嵌入式互連技術

    摘要 串行RapidIO針對高性能嵌入式系統(tǒng)芯片間和板間互連而設計，它將是未來十幾年中嵌入式系統(tǒng)互連的最佳選擇。 本文比較RapidIO和傳統(tǒng)互連技術的優(yōu)點；介紹RapidIO協(xié)議架構，包格式，互連拓撲結構以及串行Rap

  • 基于FPGA實現(xiàn)DSP與RapidIO網(wǎng)絡互聯(lián)

    本文首先簡單的介紹了總線的發(fā)展，從而引出一種新型的串行點對點交換結構RapidIO。DSP 在高性能處理系統(tǒng)中的重要性毋庸置疑，但是目前的很多DSP 并沒有RapidIO接口。本文提出了利用FPGA，將DSP 的總線橋接到一個RapidIO IP 上，從而實現(xiàn)了DSP與RapidIO 網(wǎng)絡的互聯(lián)。

  • 用RapidIO提高DSP陣列的性能

    “采用SERDES(串行/解串器)技術后只需少量引腳就能獲得很高的帶寬。由于硬件全部承擔了協(xié)議棧的處理，RapidIO減少了原來僅用于在系統(tǒng)中傳輸數(shù)據(jù)的寶貴DSP周期?！盨hippen說，“例如，多個飛思卡爾公司的StarCorebase

  • 迎合3.5G/4G基站Serial RapidIO架構趨勢的解決方案

    隨著用戶對于行動數(shù)據(jù)需求的增加，電信服務業(yè)者必須快速地布建 3.5G 和 4G 基站。這也使得下一代基站的架構需要高頻寬的背板，以容納多重的基頻卡(baseband card)數(shù)據(jù)傳輸?shù)男枨?，而基頻板則需要數(shù)組的多核心數(shù)字信

  • 全球首屈一指的RapidIO IP解決方案

    RapidIO最早是由美國Mercury Computer systems公司（美國水星計算機系統(tǒng)公司www.mc.com）為它的計算密集型信號處理系統(tǒng)自行開發(fā)的總線技術。RapidIO是一種分組交換結構，最初開發(fā)它的目的是用來連接線路板上的

  • 利用串行RapidIO實現(xiàn)FPGA協(xié)處理

    為了支持“三重播放”應用，人們對高速通信和超快速計算的需求日益增大，這向系統(tǒng)開發(fā)師、算法開發(fā)師和硬件工程師等人員提出了新的挑戰(zhàn)，要求他們將各種標準、組件和聯(lián)網(wǎng)設備融合成一個整體

  • 串行 RapidIO: 高性能嵌入式互連技術

    摘要 串行RapidIO針對高性能嵌入式系統(tǒng)芯片間和板間互連而設計，它將是未來十幾年中嵌入式系統(tǒng)互連的最佳選擇。 本文比較RapidIO和傳統(tǒng)互連技術的優(yōu)點；介紹RapidIO協(xié)議架構，包格式，互連拓撲結構以及串行Rap

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    本文首先簡單的介紹了總線的發(fā)展，從而引出一種新型的串行點對點交換結構RapidIO。DSP 在高性能處理系統(tǒng)中的重要性毋庸置疑，但是目前的很多DSP 并沒有RapidIO接口。本文提出了利用FPGA，將DSP 的總線橋接到一個RapidIO IP 上，從而實現(xiàn)了DSP與RapidIO 網(wǎng)絡的互聯(lián)。

  • 利用串行RapidIO實現(xiàn)FPGA協(xié)處理

    為了支持“三重播放”應用，人們對高速通信和超快速計算的需求日益增大，這向系統(tǒng)開發(fā)師、算法開發(fā)師和硬件工程師等人員提出了新的挑戰(zhàn)，要求他們將各種標準、組件和聯(lián)網(wǎng)設備融合成一個整體

  • 首款串行 RapidIO 2.1 IP 解決方案(Altera)

    Altera 公司 宣布推出業(yè)界首款支持 RapidIO® 2.1 規(guī)范的知識產(chǎn)權 (IP) 內(nèi)核。Altera 的串行 RapidIO IP 內(nèi)核可支持多達四條通道，每條通道速率為 5.0 GBaud，從而滿足了無線市場日益增長的帶寬和可靠性需求。該

  • 首款串行 RapidIO 2.1 IP 解決方案(Altera)

    Altera 公司 宣布推出業(yè)界首款支持 RapidIO® 2.1 規(guī)范的知識產(chǎn)權 (IP) 內(nèi)核。Altera 的串行 RapidIO IP 內(nèi)核可支持多達四條通道，每條通道速率為 5.0 GBaud，從而滿足了無線市場日益增長的帶寬和可靠性需求。該

  • IDT的RapidIO Gen2產(chǎn)品將提升無線、視頻等應用的整體性能

    關鍵字: RapidIO MCU STM8L 在無線、視頻和嵌入式系統(tǒng)(如軍事)等領域，具有廣泛兼容性的RapidIO互連架構提供了高性能的分組交換技術，能充分滿足芯片間與主板間通信(速率超過10Gbps)對可靠性與高帶寬的要求。但隨著