ADC
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快速響應(yīng)FSK控制環(huán)路系統(tǒng)的模擬前端
本文給出了快速響應(yīng)FSK控制環(huán)路模擬前端的詳細(xì)設(shè)計方案。用兩片MAX176 ADC分別量化兩個輸入通道并控制FSK調(diào)制器的PLL。這一獨特、簡單的結(jié)構(gòu)將電路尺寸和環(huán)路延遲時間降至最小，從而得到一個簡單的FSK調(diào)制器。文中介紹了部份經(jīng)過測試的基本控制回路。
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數(shù)據(jù)采集系統(tǒng)電路(ADC0840)
數(shù)據(jù)采集系統(tǒng)電路(ADC0840)
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讓超聲成像質(zhì)量更高些、功耗更低些
超聲平臺的成像質(zhì)量與系統(tǒng)功耗，向來是此消彼長的“零和游戲”，對于便攜設(shè)備尤甚。早在2007年4月，ADI推出了全球第一款集成八通道的芯片——AD9271，但一年半過去了，對于一些比較高端的應(yīng)用，該芯片似乎在功耗上顯
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流水線ADC中高速比較器的設(shè)計和分析
1、前言 在任何一個高速高分辨率的模數(shù)轉(zhuǎn)換器中，高精度和快速比較器總是起著至關(guān)重要的作用。與其它種類的ADC相比，流水線ADC 有著高速、高分辨率的特點。因此，它在電子系統(tǒng)中，有著廣泛的應(yīng)用。流水線ADC由許多
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CTDS ADC在醫(yī)療超聲系統(tǒng)中的應(yīng)用
CDTS ADC 的優(yōu)點是在最低可能的功耗下提供所需的高速度、高分辨率。在汽車、醫(yī)療、工業(yè)和測試測量設(shè)備的與傳感器相關(guān)的應(yīng)用中，此技術(shù)可以用于構(gòu)成新的結(jié)構(gòu)，使模/數(shù)轉(zhuǎn)換靠近傳感器。
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關(guān)于邏輯分析儀在ADC及相關(guān)領(lǐng)域的應(yīng)用
TWLA500在ADC及相關(guān)領(lǐng)域的應(yīng)用 FAE：現(xiàn)場技術(shù)支持。給客戶提供你所銷售產(chǎn)品應(yīng)用上的技術(shù)支持，并對客戶提出的質(zhì)量問題進(jìn)行處理。FAE與客戶直接接觸，在產(chǎn)品的應(yīng)用和市場方向上有信息上的優(yōu)勢，很多時候FAE的表
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ADC的分類與指標(biāo)
AD轉(zhuǎn)換器的分類 下面簡要介紹常用的幾種類型的基本原理及特點：積分型、逐次逼近型、并行比較型/串并行型、Σ-Δ調(diào)制型、電容陣列逐次比較型及壓頻變換型。 1）積分型（如TLC7135） 積分型AD工作原理是將輸入電壓
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低功耗、雙通道、8位ADC（Maxim）
MAX19505/MAX19506/MAX19507具有業(yè)內(nèi)最低功耗，每通道模擬電路的功耗僅為43mW(MAX19505)、 57mW(MAX19506)和74mW(MAX19507)。此外，這些ADC還具有近乎理想的8位動態(tài)性能，70MHz時的SNR為 49.8dBFS、SFDR為69dBc。MAX
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理解時鐘抖動對高速ADC的影響
對高速信號進(jìn)行高分辨率的數(shù)字化處理需審慎選擇時鐘，才不至于使其影響模數(shù)轉(zhuǎn)換器(ADC)的性能。借助本文，我們將使讀者更好地理解時鐘抖動問題及其對高速ADC性能的影響。 我們將以凌力爾特(LTC)最新推出的高性能16位
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1.25MS/s、12位、同步采樣ADC(Maxim)
MAX1377/MAX1379/MAX1383*是兩路ADC分別具有獨立的串行外設(shè)接口(SPI)與主機(jī)通信，在最大采樣速率下工作時，每個接口的最高時鐘頻率可降至20MHz。如果采樣速率較低或主機(jī)的SPI接口可以工作在高于40MHz的頻率，那么設(shè)計
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A/D轉(zhuǎn)換器測試技術(shù)及發(fā)現(xiàn)ADC中丟失的代碼
A/D轉(zhuǎn)換器的量化噪聲、丟失位、諧波失真以及其他非線性失真特性都可以通過分析轉(zhuǎn)換器輸出的頻譜分量來判定。確定由上述這些非線性特性所引起的轉(zhuǎn)換器性能的下降并不困難，因為這些都呈現(xiàn)為A/D轉(zhuǎn)換器的輸出噪聲中的一
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