PCB抄板/設(shè)計(jì)原理圖制成PCB板的過程經(jīng)驗(yàn)

通常從抄板或原理圖做成PCB板，所需要的技術(shù)要求并不高，做快PCB板很簡(jiǎn)單，但實(shí)際操作中需要先明確目標(biāo)，當(dāng)然重點(diǎn)任然是了解所用元器件的功能對(duì)布局布線的要求，合理的做好元器件的布局和PCB板的布線，一定可以做好一塊高質(zhì)量的PCB板。

PCB(PrintedCircuitBoard)，中文名稱為印制電路板，又稱印刷電路板、印刷線路板，是重要的電子部件，是電子元器件的支撐 體，是電子元器件電氣連接的提供者。由于它是采用電子印刷術(shù)制作的，故被稱為“印刷”電路板。PCB抄板，即在已經(jīng)有電子產(chǎn)品實(shí)物和電路板實(shí)物的前提下， 利用反向研發(fā)技術(shù)手段對(duì)電路板進(jìn)行逆向解析，將原有產(chǎn)品的PCB文件、物料清單(BOM)文件、原理圖文件等技術(shù)文件以及PCB絲印生產(chǎn)文件進(jìn)行1：1的 還原，然后再利用這些技術(shù)文件和生產(chǎn)文件進(jìn)行PCB制板、元器件焊接、飛針測(cè)試、電路板調(diào)試，完成原電路板樣板的完整復(fù)制。

PCB抄板，目前在業(yè)界也常被稱為電路板抄板、電路板克隆、電路板復(fù)制、PCB克隆、PCB逆向設(shè)計(jì)或PCB反向研發(fā)，關(guān)于PCB抄板的定義，業(yè)界 和學(xué)術(shù)界有多種說法，但是都不太完整，如果要給PCB抄板下一個(gè)準(zhǔn)確的定義，我們可以借鑒國內(nèi)權(quán)威的PCB抄板實(shí)驗(yàn)室的說法：PCB抄板，即在已經(jīng)有電子 產(chǎn)品實(shí)物和電路板實(shí)物的前提下，利用反向研發(fā)技術(shù)手段對(duì)電路板進(jìn)行逆向解析，將原有產(chǎn)品的PCB文件、物料清單(BOM)文件、原理圖文件等技術(shù)文件以及 PCB絲印生產(chǎn)文件進(jìn)行1：1的還原，然后再利用這些技術(shù)文件和生產(chǎn)文件進(jìn)行PCB制板、元器件焊接、飛針測(cè)試、電路板調(diào)試，完成原電路板樣板的完整復(fù) 制。由于電子產(chǎn)品都是由各類電路板組成核心控制部分進(jìn)行工作，因此，利用PCB抄板這樣一個(gè)過程，可完成任何電子產(chǎn)品全套技術(shù)資料的提取以及產(chǎn)品的仿制與 克隆。

很多人對(duì)PCB抄板概念存在誤解，事實(shí)上，隨著抄板行業(yè)的不斷發(fā)展和深化，今天的PCB抄板概念已經(jīng)得到更廣范圍的延伸，不再局限于簡(jiǎn)單的電路板的 復(fù)制和克隆，還會(huì)涉及產(chǎn)品的二次開發(fā)與新產(chǎn)品的研發(fā)。比如，通過對(duì)既有產(chǎn)品技術(shù)文件的分析、設(shè)計(jì)思路、結(jié)構(gòu)特征、工藝技術(shù)等的理解和探討，可以為新產(chǎn)品的 研發(fā)設(shè)計(jì)提供可行性分析和競(jìng)爭(zhēng)性參考，協(xié)助研發(fā)設(shè)計(jì)單位及時(shí)跟進(jìn)最新技術(shù)發(fā)展趨勢(shì)、及時(shí)調(diào)整改進(jìn)產(chǎn)品設(shè)計(jì)方案，研發(fā)最具有市場(chǎng)競(jìng)爭(zhēng)性的新產(chǎn)品。同 時(shí)，PCB抄板的過程通過對(duì)技術(shù)資料文件的提取和部分修改，可以實(shí)現(xiàn)各類型電子產(chǎn)品的快速更新升級(jí)與二次開發(fā)，根據(jù)抄板提取的文件圖與原理圖，專業(yè)設(shè)計(jì)人 員還能根據(jù)客戶的意愿對(duì)PCB進(jìn)行優(yōu)化設(shè)計(jì)與改板，也能夠在此基礎(chǔ)上為產(chǎn)品增加新的功能或者進(jìn)行功能特征的重新設(shè)計(jì)，這樣具備新功能的產(chǎn)品將以最快的速度 和全新的姿態(tài)亮相，不僅擁有了自己的知識(shí)產(chǎn)權(quán)，也在市場(chǎng)中贏得了先機(jī)，為客戶帶來的是雙重的效益。

PCB抄板即是在已有PCB電路板的情況下，對(duì)電路板進(jìn)行克隆、導(dǎo)出原理圖等，它是一種用來生產(chǎn)的文件。也可在此基礎(chǔ)上根據(jù)用戶需求進(jìn)行二次開發(fā)，重新設(shè)計(jì)，實(shí)現(xiàn)產(chǎn)品的功能升級(jí)與擴(kuò)展。那么如何從PCB抄板文件原理圖變成實(shí)實(shí)在在PCB板呢?

也許大家都知道哦，做PCB板就是把設(shè)計(jì)/克隆好的原理圖變成一塊實(shí)實(shí)在在的PCB電路板，請(qǐng)別小看這一過程，有很多原理上行得通的東西在工程中卻難以實(shí)現(xiàn)，或是別人能實(shí)現(xiàn)的東西另一些人卻實(shí)現(xiàn)不了，因此說做一塊PCB板不難，但要做好一塊PCB板卻不是一件容易的事情。

微電子領(lǐng)域的兩大難點(diǎn)在于高頻信號(hào)和微弱信號(hào)的處理，在這方面PCB制作水平就顯得尤其重要，同樣的原理圖，同樣的元器件，不同的人制作出來的PCB就具有不同的結(jié)果，那么如何才能做出一塊好的PCB板呢?根據(jù)我們以往的經(jīng)驗(yàn)，想就以下幾方面談?wù)勛约旱目捶ǎ?/p>

一、要明確目標(biāo)

接受到一個(gè)設(shè)計(jì)/抄板任務(wù)，首先要明確其目標(biāo)。是普通的PCB板、高頻PCB板、小信號(hào)處理PCB板還是既有高頻率又有小信號(hào)處理的PCB板，如果 只需設(shè)計(jì)普通的PCB板，只要做到布局布線合理整齊，機(jī)械尺寸準(zhǔn)確無誤即可，如有中負(fù)載線和長(zhǎng)線，就要采用一定的手段進(jìn)行處理，減輕負(fù)載，長(zhǎng)線要加強(qiáng)驅(qū) 動(dòng)，重點(diǎn)是防止長(zhǎng)線反射。 當(dāng)板上有超過40MHz的信號(hào)線時(shí)，就要對(duì)這些信號(hào)線進(jìn)行特殊的考慮，比如線間串?dāng)_等問題。如果頻率更高一些，對(duì)布線的長(zhǎng)度就有更嚴(yán)格的限制，根據(jù)分布參 數(shù)的網(wǎng)絡(luò)理論，高速電路與其連線間的相互作用是決定性因素，在系統(tǒng)設(shè)計(jì)時(shí)不能忽略。隨著門傳輸速度的提高，在信號(hào)線上的反對(duì)將會(huì)相應(yīng)增加，相鄰信號(hào)線間的 串?dāng)_將成正比地增加，通常高速電路的功耗和熱耗散也都很大，在做高速PCB時(shí)應(yīng)引起足夠的重視。

當(dāng)板上有毫伏級(jí)甚至微伏級(jí)的微弱信號(hào)時(shí)，對(duì)這些信號(hào)線就需要特別的關(guān)照，小信號(hào)由于太微弱，非常容易受到其它強(qiáng)信號(hào)的干擾，屏蔽措施常常是必要的，否則將大大降低信噪比。以致于有用信號(hào)被噪聲淹沒，不能有效地提取出來。

對(duì)板子的調(diào)測(cè)也要在設(shè)計(jì)階段加以考慮，測(cè)試點(diǎn)的物理位置，測(cè)試點(diǎn)的隔離等因素不可忽略，因?yàn)橛行┬⌒盘?hào)和高頻信號(hào)是不能直接把探頭加上去進(jìn)行測(cè)量的。

此外還要考慮其他一些相關(guān)因素，如板子層數(shù)，采用元器件的封裝外形，板子的機(jī)械強(qiáng)度等。在做PCB板子前，要做出對(duì)該設(shè)計(jì)的設(shè)計(jì)目標(biāo)心中有數(shù)。

二、了解所用元器件的功能對(duì)布局布線的要求

我們知道，有些特殊元器件在布局布線時(shí)有特殊的要求，比如LOTI和APH所用的模擬信號(hào)放大器，模擬信號(hào)放大器對(duì)電源要求要平穩(wěn)、紋波小。模擬小 信號(hào)部分要盡量遠(yuǎn)離功率器件。在OTI板上，小信號(hào)放大部分還專門加有屏蔽罩，把雜散的電磁干擾給屏蔽掉。NTOI板上用的GLINK芯片采用的是ECL 工藝，功耗大發(fā)熱厲害，對(duì)散熱問題必須在布局時(shí)就必須進(jìn)行特殊考慮，若采用自然散熱，就要把GLINK芯片放在空氣流通比較順暢的地方，而且散出來的熱量 還不能對(duì)其它芯片構(gòu)成大的影響。如果板子上裝有喇叭或其他大功率的器件，有可能對(duì)電源造成嚴(yán)重的污染這一點(diǎn)也應(yīng)引起足夠的重視。

三、元器件布局的考慮

元器件的布局首先要考慮的一個(gè)因素就是電性能，把連線關(guān)系密切的元器件盡量放在一起，尤其對(duì)一些高速線，布局時(shí)就要使它盡可能地短，功率信號(hào)和小信 號(hào)器件要分開。在滿足電路性能的前提下，還要考慮元器件擺放整齊、美觀，便于測(cè)試，板子的機(jī)械尺寸，插座的位置等也需認(rèn)真考慮。

高速系統(tǒng)中的接地和互連線上的傳輸延遲時(shí)間也是在系統(tǒng)設(shè)計(jì)時(shí)首先要考慮的因素。信號(hào)線上的傳輸時(shí)間對(duì)總的系統(tǒng)速度影響很大，特別是對(duì)高速的ECL電 路，雖然集成電路塊本身速度很高，但由于在底板上用普通的互連線(每30cm線長(zhǎng)約有2ns的延遲量)帶來延遲時(shí)間的增加，可使系統(tǒng)速度大為降低。象移位 寄存器，同步計(jì)數(shù)器這種同步工作部件最好放在同一塊插件板上，因?yàn)榈讲煌寮迳系臅r(shí)鐘信號(hào)的傳輸延遲時(shí)間不相等，可能使移位寄存器產(chǎn)主錯(cuò)誤，若不能放在 一塊板上，則在同步是關(guān)鍵的地方，從公共時(shí)鐘源連到各插件板的時(shí)鐘線的長(zhǎng)度必須相等。

四、對(duì)布線的考慮

隨著OTNI和星形光纖網(wǎng)的設(shè)計(jì)完成，以后會(huì)有更多的100MHz以上的具有高速信號(hào)線的板子需要設(shè)計(jì)，這里將介紹高速線的一些基本概念。

1.傳輸線

印制電路板上的任何一條“長(zhǎng)”的信號(hào)通路都可以視為一種傳輸線。如果該線的傳輸延遲時(shí)間比信號(hào)上升時(shí)間短得多，那么信號(hào)上升期間所產(chǎn)主的反射都將被 淹沒。不再呈現(xiàn)過沖、反沖和振鈴，對(duì)現(xiàn)時(shí)大多數(shù)的MOS電路來說，由于上升時(shí)間對(duì)線傳輸延遲時(shí)間之比大得多，所以走線可長(zhǎng)以米計(jì)而無信號(hào)失真。而對(duì)于速度 較快的邏輯電路，特別是超高速ECL集成電路來說，由于邊沿速度的增快，若無其它措施，走線的長(zhǎng)度必須大大縮短，以保持信號(hào)的完整性。

有兩種方法能使高速電路在相對(duì)長(zhǎng)的線上工作而無嚴(yán)重的波形失真，TTL對(duì)快速下降邊沿采用肖特基二極管箝位方法，使過沖量被箝制在比地電位低一個(gè)二 極管壓降的電平上，這就減少了后面的反沖幅度，較慢的上升邊緣允許有過沖，但它被在電平“H”狀態(tài)下電路的相對(duì)高的輸出阻抗(50～80Ω)所衰減。此 外，由于電平“H”狀態(tài)的抗擾度較大，使反沖問題并不十分突出，對(duì)HCT系列的器件，若采用肖特基二極管箝位和串聯(lián)電阻端接方法相結(jié)合，其改善的效果將會(huì) 更加明顯。

當(dāng)沿信號(hào)線有扇出時(shí)，在較高的位速率和較快的邊沿速率下，上述介紹的TTL整形方法顯得有些不足。因?yàn)榫€中存在著反射波，它們?cè)诟呶凰俾氏聦②呌诤? 成，從而引起信號(hào)嚴(yán)重失真和抗干擾能力降低。因此，為了解決反射問題，在ECL系統(tǒng)中通常使用另外一種方法：線阻抗匹配法。用這種方法能使反射受到控制， 信號(hào)的完整性得到保證。

嚴(yán)格他說，對(duì)于有較慢邊沿速度的常規(guī)TTL和CMOS器件來說，傳輸線并不是十分需要的。對(duì)有較快邊沿速度的高速ECL器件，傳輸線也不總是需要的。但是當(dāng)使用傳輸線時(shí)，它們具有能預(yù)測(cè)連線時(shí)延和通過阻抗匹配來控制反射和振蕩的優(yōu)點(diǎn)。

1、決定是否采用傳輸線的基本因素有以下五個(gè)。它們是：

(1)系統(tǒng)信號(hào)的沿速率，

(2)連線距離

(3)容性負(fù)載(扇出的多少)，

(4)電阻性負(fù)載(線的端接方式);

(5)允許的反沖和過沖百分比(交流抗擾度的降低程度)。

2.傳輸線的幾種類型

(1) 同軸電纜和雙絞線：它們經(jīng)常用在系統(tǒng)與系統(tǒng)之間的連接。同軸電纜的特性阻抗通常有50Ω和75Ω，雙絞線通常為110Ω。

(2)印制板上的微帶線

微帶線是一根帶狀導(dǎo)(信號(hào)線)。與地平面之間用一種電介質(zhì)隔離開。如果線的厚度、寬度以及與地平面之間的距離是可控制的，則它的特性阻抗也是可以控制的。

(3)印制板中的帶狀線

帶狀線是一條置于兩層導(dǎo)電平面之間的電介質(zhì)中間的銅帶線。如果線的厚度和寬度、介質(zhì)的介電常數(shù)以及兩層導(dǎo)電平面間的距離是可控的，那么線的特性阻抗也是可控的。

同樣，單位長(zhǎng)度帶狀線的傳輸延遲時(shí)間與線的寬度或間距是無關(guān)的;僅取決于所用介質(zhì)的相對(duì)介電常數(shù)。

3.端接傳輸線

在一條線的接收端用一個(gè)與線特性阻抗相等的電阻端接，則稱該傳輸線為并聯(lián)端接線。它主要是為了獲得最好的電性能，包括驅(qū)動(dòng)分布負(fù)載而采用的。

有時(shí)為了節(jié)省電源消耗，對(duì)端接的電阻上再串接一個(gè)104電容形成交流端接電路，它能有效地降低直流損耗。

在驅(qū)動(dòng)器和傳輸線之間串接一個(gè)電阻，而線的終端不再接端接電阻，這種端接方法稱之為串聯(lián)端接。較長(zhǎng)線上的過沖和振鈴可用串聯(lián)阻尼或串聯(lián)端接技術(shù)來控 制。串聯(lián)阻尼是利用一個(gè)與驅(qū)動(dòng)門輸出端串聯(lián)的小電阻(一般為10～75Ω)來實(shí)現(xiàn)的。這種阻尼方法適合與特性阻抗來受控制的線相聯(lián)用(如底板布線，無地平 面的電路板和大多數(shù)繞接線等。

串聯(lián)端接時(shí)串聯(lián)電阻的值與電路(驅(qū)動(dòng)門)輸出阻抗之和等于傳輸線的特性阻抗。串聯(lián)聯(lián)端接線存在著只能在終端使用集總負(fù)載和傳輸延遲時(shí)間較長(zhǎng)的缺點(diǎn)。但是，這可以通過使用多余串聯(lián)端接傳輸線的方法加以克服。

4.非端接傳輸線

如果線延遲時(shí)間比信號(hào)上升時(shí)間短得多，可以在不用串聯(lián)端接或并聯(lián)端接的情況下使用傳輸線，如果一根非端接線的雙程延遲(信號(hào)在傳輸線上往返一次的時(shí)間)比脈沖信號(hào)的上升時(shí)間短，那么由于非端接所引起的反沖大約是邏輯擺幅的15%。最大開路線長(zhǎng)度近似為：

Lmax

式中：tr為上升時(shí)間

tpd為單位線長(zhǎng)的傳輸延遲時(shí)間

5.幾種端接方式的比較

并聯(lián)端接線和串聯(lián)端接線都各有優(yōu)點(diǎn)，究竟用哪一種，還是兩種都用，這要看設(shè)計(jì)者的愛好和系統(tǒng)的要求而定。并聯(lián)端接線的主要優(yōu)點(diǎn)是系統(tǒng)速度快和信號(hào)在 線上傳輸完整無失真。長(zhǎng)線上的負(fù)載既不會(huì)影響驅(qū)動(dòng)長(zhǎng)線的驅(qū)動(dòng)門的傳輸延遲時(shí)間，又不會(huì)影響它的信號(hào)邊沿速度，但將使信號(hào)沿該長(zhǎng)線的傳輸延遲時(shí)間增大。在驅(qū) 動(dòng)大扇出時(shí)，負(fù)載可經(jīng)分支短線沿線分布，而不象串聯(lián)端接中那樣必須把負(fù)載集總在線的終端。

串聯(lián)端接方法使電路有驅(qū)動(dòng)幾條平行負(fù)載線的能力，串聯(lián)端接線由于容性負(fù)載所引起的延遲時(shí)間增量約比相應(yīng)并聯(lián)端接線的大一倍，而短線則因容性負(fù)載使邊 沿速度放慢和驅(qū)動(dòng)門延遲時(shí)間增大，但是，串聯(lián)端接線的串?dāng)_比并聯(lián)端接線的要小，其主要原因是沿串聯(lián)端接線傳送的信號(hào)幅度僅僅是二分之一的邏輯擺幅，因而開 關(guān)電流也只有并聯(lián)端接的開關(guān)電流的一半，信號(hào)能量小串?dāng)_也就小。

五、PCB板的布線技術(shù)

做PCB時(shí)是選用雙面板還是多層板，要看最高工作頻率和電路系統(tǒng)的復(fù)雜程度以及對(duì)組裝密度的要求來決定。在時(shí)鐘頻率超過200MHZ時(shí)最好選用多層 板。如果工作頻率超過350MHz，最好選用以聚四氟乙烯作為介質(zhì)層的印制電路板，因?yàn)樗母哳l衰耗要小些，寄生電容要小些，傳輸速度要快些，還由于Z0 較大而省功耗，對(duì)印制電路板的走線有如下原則要求

(1)所有平行信號(hào)線之間要盡量留有較大的間隔，以減少串?dāng)_。如果有兩條相距較近的信號(hào)線，最好在兩線之間走一條接地線，這樣可以起到屏蔽作用。

(2) 設(shè)計(jì)信號(hào)傳輸線時(shí)要避免急拐彎，以防傳輸線特性阻抗的突變而產(chǎn)生反射，要盡量設(shè)計(jì)成具有一定尺寸的均勻的圓弧線。

印制板的寬度可根據(jù)上述微帶線和帶狀線的特性阻抗計(jì)算公式計(jì)算，印制電路板上的微帶線的特性阻抗一般在50～120Ω之間。要想得到大的特性阻抗， 線寬必須做得很窄。但很細(xì)的線條又不容易制作。綜合各種因素考慮，一般選擇68Ω左右的阻抗值比較合適，因?yàn)檫x擇68Ω的特性阻抗，可以在延遲時(shí)間和功耗 之間達(dá)到最佳平衡。一條50Ω的傳輸線將消耗更多的功率;較大的阻抗固然可以使消耗功率減少，但會(huì)使傳輸延遲時(shí)間憎大。由于負(fù)線電容會(huì)造成傳輸延遲時(shí)間的 增大和特性阻抗的降低。但特性阻抗很低的線段單位長(zhǎng)度的本征電容比較大，所以傳輸延遲時(shí)間及特性阻抗受負(fù)載電容的影響較小。具有適當(dāng)端接的傳輸線的一個(gè)重 要特征是，分枝短線對(duì)線延遲時(shí)間應(yīng)沒有什么影響。當(dāng)Z0為50Ω時(shí)。分枝短線的長(zhǎng)度必須限制在2.5cm以內(nèi)。以免出現(xiàn)很大的振鈴。

(4)對(duì)于雙面板(或六層板中走四層線)，電路板兩面的線要互相垂直，以防止互相感應(yīng)產(chǎn)主串?dāng)_。

(5)印制板上若裝有大電流器件，如繼電器、指示燈、喇叭等，它們的地線最好要分開單獨(dú)走，以減少地線上的噪聲，這些大電流器件的地線應(yīng)連到插件板和背板上的一個(gè)獨(dú)立的地總線上去，而且這些獨(dú)立的地線還應(yīng)該與整個(gè)系統(tǒng)的接地點(diǎn)相連接。

(6)如果板上有小信號(hào)放大器，則放大前的弱信號(hào)線要遠(yuǎn)離強(qiáng)信號(hào)線，而且走線要盡可能地短，如有可能還要用地線對(duì)其進(jìn)行屏蔽。

以下是PCB抄板流程：

第一步，拿到一塊PCB，首先在紙上記錄好所有元?dú)饧男吞?hào)，參數(shù)，以及位置，尤其是二極管，三機(jī)管的方向，IC缺口的方向。

第二步，拆掉所有器件，并且將PAD孔里的錫去掉。用酒精將PCB清洗干凈，然后放入掃描儀內(nèi)，啟動(dòng)POHTOSHOP，用彩色方式將絲印面掃入，并打印出來備用。

第三步，用水紗紙將TOP LAYER 和BOTTOM LAYER兩層輕微打磨，打磨到銅膜發(fā)亮，放入掃描儀，啟動(dòng)PHOTOSHOP，用彩色方式將兩層分別掃入。

第四步，調(diào)整畫布的對(duì)比度，明暗度，使有銅膜的部分和沒有銅膜的部分對(duì)比強(qiáng)烈，然后將次圖轉(zhuǎn)為黑白色，檢查線條是否清晰，如果不清晰，則重復(fù)本步驟。如果清晰，將圖存為黑白BMP格式文件TOP.BMP和BOT.BMP。

第五步，將兩個(gè)BMP格式的文件分別轉(zhuǎn)為PROTEL格式文件，在PROTEL中調(diào)入兩層，如過兩層的PAD和VIA的位置基本重合，表明前幾個(gè)步驟做的很好，如果有偏差，則重復(fù)第三步。

第六，將TOP。BMP轉(zhuǎn)化為TOP。PCB，并且根據(jù)第二步的圖紙放置器件。

第七步，將BOT。BMP轉(zhuǎn)化為BOT。PCB。

第八步，在PROTEL中將TOP。PCB和BOT。PCB調(diào)入，合為一個(gè)圖。

第九步，用激光打印機(jī)將TOP LAYER， BOTTOM LAYER分別打印到透明膠片上(1：1的比例)，把膠片放到那塊PCB上，比較是否有誤。