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三種嵌入式操作系統(tǒng)的分析與比析
嵌入式系統(tǒng)是以嵌入式計(jì)算機(jī)為技術(shù)核心，面向用戶、面向產(chǎn)品、面向應(yīng)用，軟硬件可裁減的，適用于對(duì)功能、可靠性、成本、體積、功耗等綜合性能有嚴(yán)格要求的專用計(jì)算機(jī)系統(tǒng)。
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基于單片機(jī)通用引腳的軟件UART設(shè)計(jì)
通過對(duì)串口技術(shù)的研究，提出了一種用軟件實(shí)現(xiàn)串口擴(kuò)展的方法，該方法僅使用2個(gè)普通I/O引腳和1個(gè)定時(shí)器，實(shí)現(xiàn)了帶FIFO的高速全雙工串口。該方法可以節(jié)約系統(tǒng)開發(fā)的硬件開銷。文中給出了設(shè)計(jì)程序，在STC12C1052單片機(jī)上進(jìn)行測(cè)試，其通信速率達(dá)到38400bps。
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用CPLD實(shí)現(xiàn)FIR數(shù)字濾波器的設(shè)計(jì)
介紹了一種利用ALTERA公司的復(fù)雜可編程邏輯器件（CPLD）快速卷積法實(shí)現(xiàn)數(shù)字濾波器的設(shè)計(jì)
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軟件無線電的功率：一種針對(duì)功率設(shè)計(jì)SDR的整體方法
傳統(tǒng)上，降低軟件無線電(SDR)硬件的功耗一直是我們工作的重點(diǎn)，但是，顯而易見軟件也有重要影響，因此，需要一種降低SDR功耗的整體設(shè)計(jì)方法。一種能發(fā)揮SDR功能的測(cè)試床能幫我們解決這個(gè)問題。
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DSP+FPGA結(jié)構(gòu)在雷達(dá)模擬系統(tǒng)中的應(yīng)用
隨著信息技術(shù)革命的深入和計(jì)算機(jī)技術(shù)的飛速發(fā)展，低速、低可靠性的單片機(jī)以及小規(guī)模的集成電路已經(jīng)越來越不能滿足需要，正逐漸被DSP與可編程邏輯器件（如FPGA、CPLD）所取代。
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ＤＳＰ＋ＦＰＧＡ實(shí)時(shí)信號(hào)處理系統(tǒng)
簡要敘述了常用的信號(hào)處理系統(tǒng)的類型與處理機(jī)結(jié)構(gòu)，介紹了正逐步得到廣泛應(yīng)用的ＤＳＰ＋ＦＰＧＡ處理機(jī)結(jié)構(gòu)，在此基礎(chǔ)上提出了一種實(shí)時(shí)信號(hào)處理的線性流水陣列，并舉例說明了該結(jié)構(gòu)的具體實(shí)現(xiàn)，最后分析說明了此結(jié)構(gòu)的優(yōu)越性。
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U-Boot的編譯與移植到QT-S3C44B0X開發(fā)板上
U-Boot的編譯與移植到QT-S3C44B0X開發(fā)板上
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DSP和FPGA的電視觀瞄系統(tǒng)設(shè)計(jì)
FPGA的基準(zhǔn)時(shí)鐘為來自DSP輸出的32MHz時(shí)鐘，經(jīng)過片內(nèi)數(shù)字時(shí)鐘網(wǎng)絡(luò)(PLL)，可以得到系統(tǒng)所需要的多種時(shí)鐘。圖文混合主要是控制觀瞄系統(tǒng)顯示屏的顯示內(nèi)容與相應(yīng)的位置。利用EP2S30F484的內(nèi)部RAM配置了許多獨(dú)立的小RAM塊，DSP根據(jù)不同的控制命令向這些RAM塊寫入不同的顯示內(nèi)容。FPGA再根據(jù)顯示位置的分布，以記數(shù)的方式在屏幕上控制顯示內(nèi)容輸出，達(dá)到圖文混合。
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4種實(shí)時(shí)操作系統(tǒng)實(shí)時(shí)性的分析對(duì)比
本文分析了適用于測(cè)控領(lǐng)域的4種實(shí)時(shí)操作系統(tǒng)，并對(duì)比了它們實(shí)時(shí)性能的重要指標(biāo)，歸納了實(shí)時(shí)性設(shè)計(jì)和實(shí)現(xiàn)中的若干問題。
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MiniGUI：跨操作系統(tǒng)的嵌入式圖形支持系統(tǒng)
為目標(biāo)嵌入式產(chǎn)品選擇適合的嵌入式圖形支持系統(tǒng)成為與選擇嵌入式操作系統(tǒng)一樣頗具挑戰(zhàn)性。本土公司開發(fā)的MiniGUI是一個(gè)高效、可靠、可定制、小巧靈活的圖形用戶界面支持系統(tǒng)，并具有跨硬件平臺(tái)、跨操作系統(tǒng)的可移植性，非常適合于實(shí)時(shí)嵌入式產(chǎn)品開發(fā)。本文詳細(xì)闡述了MiniGUI的特點(diǎn)、運(yùn)行模式和應(yīng)用。
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等價(jià)型PG邏輯及其在加法器設(shè)計(jì)中的應(yīng)用
在全加器設(shè)計(jì)中運(yùn)用PG邏輯是非常普遍的，本文在設(shè)計(jì)和研究全加器時(shí)，根據(jù)現(xiàn)有的PG邏輯公式推導(dǎo)出了一種新的邏輯公式，并論證了兩者之間的等價(jià)關(guān)系。這一新的公式能夠指導(dǎo)全加器設(shè)計(jì)中的連線方式，靈活更改連線策略。本文將從基本原理開始逐步引出該公式，對(duì)其進(jìn)行論證，并應(yīng)用于全加器設(shè)計(jì)中。
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基于DSP+CPLD的交流電機(jī)調(diào)速在水處理控制中的應(yīng)用
生化反應(yīng)池在水處理過程中非常重要。需要通過調(diào)整風(fēng)機(jī)的轉(zhuǎn)速控制反應(yīng)池中的DO值。理論上應(yīng)該通過調(diào)節(jié)電動(dòng)機(jī)的轉(zhuǎn)速來實(shí)現(xiàn)，但實(shí)際上卻是利用擋板閥門后者放空的方法進(jìn)行調(diào)節(jié)。這種方法極大地浪費(fèi)了電力資源。以美國TI公司推出的TMS320LF2407為代表的面向電機(jī)控制的高性能數(shù)字信號(hào)處理可以對(duì)電機(jī)進(jìn)行精確控制，大大提高了交流電機(jī)的性能，能夠設(shè)計(jì)出性能優(yōu)良的控制系統(tǒng)。
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手機(jī)語音識(shí)別應(yīng)用中DSP的選擇策略
3G手機(jī)的數(shù)據(jù)速率將高達(dá)2Mbps，因而能支持包括數(shù)據(jù)服務(wù)和互聯(lián)網(wǎng)連接在內(nèi)的各種多媒體應(yīng)用，相對(duì)2G產(chǎn)品而言，其主要特點(diǎn)是屏幕更大、鍵盤更小。為了解決用小鍵盤進(jìn)行撥號(hào)和單詞輸入的難題，利用自動(dòng)語音識(shí)別(ASR)功能完成語音撥號(hào)將成為3G手機(jī)的新特點(diǎn)。本文介紹高性能低成本、低功耗DSP芯片在下一代無鍵盤手機(jī)應(yīng)用中的選擇策略。
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基于FPGA的快速并行FFT及其在空間太陽望遠(yuǎn)鏡圖像鎖定系統(tǒng)中的應(yīng)用
在空間太陽望遠(yuǎn)鏡的在軌高速數(shù)據(jù)處理中，運(yùn)算時(shí)間是影響系統(tǒng)性能的重要環(huán)節(jié)之一。利用FPGA豐富的邏輯單元實(shí)現(xiàn)快速傅里葉變換（FFT），解決 了在軌實(shí)時(shí)大數(shù)據(jù)量圖像處理與航天級(jí)DSP運(yùn)算速度不足之間的矛盾；利用溢出監(jiān)測(cè)移位結(jié)構(gòu)解決了定點(diǎn)運(yùn)算的動(dòng)態(tài)范圍問題。經(jīng)過實(shí)驗(yàn)驗(yàn)證，各項(xiàng)指標(biāo)均達(dá)到了設(shè)計(jì)要求。
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ALTERA FPGA在微處理器系統(tǒng)中的在應(yīng)用配置
ALTERA公司SRAM工藝可編程器件應(yīng)用廣泛，專用配置器件比較昂貴。在具有微處理器的系統(tǒng)中，使用微處理器系統(tǒng)的存儲(chǔ)器來存儲(chǔ)配置數(shù)據(jù)，并通過微處理器配置FPGA，這種方法幾乎不增加成本。微處理器根據(jù)不同的程序應(yīng)用，采用不同的配置數(shù)據(jù)對(duì)FPGA進(jìn)行配置，使FPGA實(shí)現(xiàn)與該應(yīng)用有關(guān)的特定功能。詳細(xì)介紹了微處理器系統(tǒng)中連接簡單的被動(dòng)串行配置方法和被動(dòng)并行異步配置方法。
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數(shù)字簽名算法SHA-1的FPGA高速實(shí)現(xiàn)
隨著網(wǎng)絡(luò)的迅速發(fā)展，信息安全越來越重要，信息認(rèn)證是驗(yàn)證收到信息來源和內(nèi)容的基本技術(shù)。常用的信息驗(yàn)證碼是使用單向散列函數(shù)生成驗(yàn)證碼，安全散列算法SHA-1使用在是因特網(wǎng)協(xié)議安全性(IPSec)標(biāo)準(zhǔn)中。在設(shè)計(jì)中使用FPGA高速實(shí)現(xiàn)SHA-1認(rèn)證算法，以PCI卡形式處理認(rèn)證服務(wù)。
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網(wǎng)絡(luò)協(xié)議全了解
當(dāng)我們使用瀏覽器在Internet這個(gè)高速公路縱橫馳騁時(shí)，需要用到諸如http、FTP之類的傳輸控制協(xié)議來準(zhǔn)確尋找資源，獲取文件，這類傳輸控制協(xié)議就好象是公路上的交通標(biāo)志一樣，如果你不了解它，將無法到達(dá)你希望去的地方。下面筆者就來說說這方面的問題，希望能給初次沖浪的朋友帶來一些方便。
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FPGA和DSP明幫暗戰(zhàn)，爭奪20億美元高性能信號(hào)處理市場(chǎng)
經(jīng)過20多年的努力后，在工藝技術(shù)進(jìn)步和市場(chǎng)需求的推動(dòng)下，“大器晚成”的FPGA終于從外圍邏輯應(yīng)用進(jìn)入到信號(hào)處理系統(tǒng)核心。在多個(gè)應(yīng)用場(chǎng)合擊敗ASIC后，現(xiàn)在FPGA廠商又開始將目光瞄向了一向是親密戰(zhàn)友的DSP陣營。
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基于FPGA的異構(gòu)可重配置DSP平臺(tái)
視頻、影像和電信市場(chǎng)的標(biāo)準(zhǔn)推動(dòng)了異構(gòu)可重配置DSP硬件平臺(tái)的使用。在本文中這些平臺(tái)包括DSP處理器和FPGA，它們提供的現(xiàn)成硬件解決方案可以解決視頻、影像和電信設(shè)計(jì)中的重大難題，同時(shí)又不失差異化設(shè)計(jì)所需的足夠的可定制性。
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DSP+FPGA在高速高精運(yùn)動(dòng)控制器中的應(yīng)用
數(shù)字信號(hào)處理器具有高效的數(shù)值運(yùn)算能力,并能提供良好的開發(fā)環(huán)境，而可編程邏輯器件具有高度靈活的可配置性。本文描述了通過采用TMS320C32浮點(diǎn)DSP和可編程邏輯器件（FPGA）的組合運(yùn)用來構(gòu)成高速高精運(yùn)動(dòng)控制器， 該系統(tǒng)通過B樣條插值算法對(duì)運(yùn)動(dòng)曲線進(jìn)行平滑處理以及運(yùn)用離散PID算法對(duì)運(yùn)動(dòng)過程加以控制。
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